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龍圖騰網(wǎng)獲悉北京嘉楠捷思信息技術(shù)有限公司申請(qǐng)的專利動(dòng)態(tài)D觸發(fā)器獲國(guó)家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國(guó)家知識(shí)產(chǎn)權(quán)局授予，授權(quán)公告號(hào)為：CN110635786B 。

龍圖騰網(wǎng)通過(guò)國(guó)家知識(shí)產(chǎn)權(quán)局官網(wǎng)在2025-08-12發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請(qǐng)?zhí)?專利號(hào)為：201810667322.X，技術(shù)領(lǐng)域涉及：H03K3/012；該發(fā)明授權(quán)動(dòng)態(tài)D觸發(fā)器是由劉杰堯;張楠賡;吳敬杰;馬晟厚設(shè)計(jì)研發(fā)完成，并于2018-06-25向國(guó)家知識(shí)產(chǎn)權(quán)局提交的專利申請(qǐng)。

本動(dòng)態(tài)D觸發(fā)器在說(shuō)明書摘要公布了：本發(fā)明提供一種在計(jì)算設(shè)備中應(yīng)用的動(dòng)態(tài)D觸發(fā)器，一輸入端、一輸出端以及至少一時(shí)鐘信號(hào)端；一第一鎖存單元，用于傳輸所述輸入端的數(shù)據(jù)并在時(shí)鐘信號(hào)控制下鎖存所述數(shù)據(jù)；一第二鎖存單元，用于鎖存所述輸出端的數(shù)據(jù)并在時(shí)鐘信號(hào)控制下將所述第一鎖存單元鎖存的所述數(shù)據(jù)反相傳輸；一輸出驅(qū)動(dòng)單元，用于反相并輸出從所述第二鎖存單元接收到的所述數(shù)據(jù)；所述第一鎖存單元、所述第二鎖存單元以及所述輸出驅(qū)動(dòng)單元依次串接在所述輸入端和所述輸出端之間；其中，所述第二鎖存單元在時(shí)鐘信號(hào)控制下通過(guò)單一元件實(shí)現(xiàn)高電平、低電平和高阻三種狀態(tài)的輸出。借此，本發(fā)明可以有效減小芯片面積，降低功耗、減小邏輯延時(shí)。

本發(fā)明授權(quán)動(dòng)態(tài)D觸發(fā)器在權(quán)利要求書中公布了：1.一種動(dòng)態(tài)D觸發(fā)器，其特征在于，包括： 一輸入端、一輸出端以及至少一時(shí)鐘信號(hào)端； 一第一鎖存單元，用于傳輸所述輸入端的數(shù)據(jù)并在互補(bǔ)的時(shí)鐘信號(hào)控制下鎖存所述數(shù)據(jù)；其中所述第一鎖存單元為傳輸門，所述傳輸門采用PMOS晶體管與NMOS晶體管并聯(lián)連接，并在互補(bǔ)的時(shí)鐘信號(hào)的控制下組成模擬開(kāi)關(guān)； 一第二鎖存單元，為三態(tài)反相器，用于鎖存所述輸出端的數(shù)據(jù)并在互補(bǔ)的時(shí)鐘信號(hào)控制下將所述第一鎖存單元鎖存的所述數(shù)據(jù)反相傳輸； 一輸出驅(qū)動(dòng)單元，用于反相并輸出從所述第二鎖存單元接收到的所述數(shù)據(jù)； 所述第一鎖存單元、所述第二鎖存單元以及所述輸出驅(qū)動(dòng)單元依次串接在所述輸入端和所述輸出端之間； 其中，所述第二鎖存單元在互補(bǔ)的時(shí)鐘信號(hào)控制下通過(guò)單一元件實(shí)現(xiàn)高電平、低電平和高阻三種狀態(tài)的輸出；且在高阻狀態(tài)時(shí)，所述第二鎖存單元通過(guò)自身的寄生電容實(shí)現(xiàn)數(shù)據(jù)保持。

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