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龍圖騰網(wǎng)獲悉電子科技大學申請的專利一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN115391250B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-08-08發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202210819109.2，技術(shù)領(lǐng)域涉及：G06F13/38；該發(fā)明授權(quán)一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)是由彭禮彪;畢東杰;李西峰;李洪;謝永樂;帥萍;唐宇;謝暄設(shè)計研發(fā)完成，并于2022-07-12向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)在說明書摘要公布了：該發(fā)明公開了一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)，涉及高速高可靠數(shù)字信號處理系統(tǒng)設(shè)計領(lǐng)域。本發(fā)明實現(xiàn)異構(gòu)并行信號運算及處理，外部數(shù)據(jù)可通過VPX連接器，以太網(wǎng)模塊或光模塊傳輸至FPGA處理器模塊、DSP處理器模塊進行運算，針對算力要求高的應用數(shù)據(jù)可使用DSP進行運算,針對具有算法硬件可編程的應用數(shù)據(jù)可使用FPGA進行運算，同時板到板連接模塊可支持板載擴展。本發(fā)明硬件系統(tǒng)支持在線動態(tài)重構(gòu)、遠程加載、故障狀態(tài)監(jiān)控及故障自修復功能。

本發(fā)明授權(quán)一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)在權(quán)利要求書中公布了：1.一種基于VPX標準的動態(tài)可重構(gòu)多核心異構(gòu)數(shù)字信號處理硬件系統(tǒng)，該系統(tǒng)包括FPGA處理器模塊、DSP處理器模塊、VPX連接器、SRIO交換模塊、以太網(wǎng)模塊、光模塊、電源管理模塊、時鐘管理模塊、存儲模塊、BMC管理模塊、CAN總線控制器、板到板連接模塊；其中FPGA處理器模塊包含3個FPGA：FPGA1、FPGA2、FPGA3；DSP處理器模塊包含兩個DSP：DSP1、DSP2；存儲模塊包含F(xiàn)LASH模塊、DDR3模塊；所述VPX連接器分別連接：FPGA1、以太網(wǎng)模塊、FPGA2、FPGA3、CAN總線控制器；FPGA1、FPGA2、DSP1之間相互連接，F(xiàn)PGA1、FPGA2之間相互連接，F(xiàn)PGA1、FPGA2、DSP2之間相互連接，F(xiàn)PGA1、FPGA2、FPGA3、DSP1、DSP2都連接SRIO交換模塊；DSP1、DSP2都與以太網(wǎng)模塊連接，F(xiàn)PGA3還要單獨連接以太網(wǎng)模塊、CAN總線控制器、BMC管理模塊、時鐘管理模塊、電源管理模塊、DSP1、DSP2、FPGA1、FPGA2；所述DSP1、DSP2、FPGA3都設(shè)置有對應的FLASH模塊、DDR3模塊，F(xiàn)PGA1、FPGA2都設(shè)置有對應的FLASH模塊、板到板連接器； 時鐘管理模塊為系統(tǒng)各模塊提供時鐘，并受FPGA3控制時鐘分配； 電源管理模塊受FPGA3控制電源開斷； FPGA3以Selectmap接口、8對LVDS接口和9個LVCOMS接口與FPGA1、FPGA2相連； FPGA3通過GPIO接口與SPI接口與DSP1、DSP2相連； FPGA1、FPGA2接口相同，管腳分配一致；DSP1、DSP2接口相同，管腳分配一致。

如需購買、轉(zhuǎn)讓、實施、許可或投資類似專利技術(shù)，可聯(lián)系本專利的申請人或?qū)＠麢?quán)人電子科技大學，其通訊地址為：611731 四川省成都市高新區(qū)（西區(qū)）西源大道2006號；或者聯(lián)系龍圖騰網(wǎng)官方客服，聯(lián)系龍圖騰網(wǎng)可撥打電話0551-65771310或微信搜索“龍圖騰網(wǎng)”。